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Torre Arnanz, Eduardo De La eduardo.delatorre@upm.es

AUTOMÁTICA, INGENIERÍA ELÉCTRICA Y ELECTRÓNICA E INFORMÁTICA INDUSTRIAL / Universidad Politécnica de Madrid

Publications

Welcome to the 2014 Conference on Design and Architectures for Signal and Image Processing (DASIP) in Madrid, Spain

  • De La Torre E
  • Pillement S

Conference On Design And Architectures For Signal And Image Processing, Dasip - 1/1/2015

10.1109/dasip.2014.7115597 View at source

  • ISSN 21649766

Using SRAM based FPGAs for power-aware high performance wireless sensor networks

  • Valverde, Juan
  • Otero, Andres
  • Lopez, Miguel
  • Portilla, Jorge
  • de la Torre, Eduardo
  • Riesgo, Teresa

Sensors (p. 2667-2692) - 1/3/2012

10.3390/s120302667 View at source

  • ISSN 14248220

Sophisticated security verification on routing repaired balanced cell-based dual-rail logic against side channel analysis

  • He, Wei
  • Bhasin, Shivam
  • Otero, Andres
  • Graba, Tarik
  • de la Torre, Eduardo
  • Danger, Jean-Luc;

Iet Information Security (p. 1-13) - 1/1/2015

10.1049/iet-ifs.2013.0058 View at source

  • ISSN 17518709

Self-Reconfigurable Evolvable Hardware System for Adaptive Image Processing

  • Salvador, Ruben
  • Otero, Andres
  • Mora, Javier
  • de la Torre, Eduardo
  • Riesgo, Teresa
  • Sekanina, Lukas;

Ieee Transactions On Computers (p. 1481-1493) - 22/7/2013

10.1109/tc.2013.78 View at source

  • ISSN 00189340

Scalable Hardware-Based On-Board Processing for Run-Time Adaptive Lossless Hyperspectral Compression

  • Rodriguez, Alfonso
  • Santos, Lucana
  • Sarmiento, Roberto
  • De La Torre, Eduardo;

Ieee Access (p. 10644-10652) - 1/1/2019

10.1109/access.2019.2892308 View at source

  • ISSN 21693536

Run-Time Reconfigurable MPSoC-Based On-Board Processor for Vision-Based Space Navigation

  • Pérez A
  • Rodríguez A
  • Otero A
  • Arjona DG
  • Jiménez-Peralo Á
  • Verdugo MÁ
  • De La Torre E
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Ieee Access (p. 59891-59905) - 1/1/2020

10.1109/access.2020.2983308 View at source

  • ISSN 21693536

Reconfigurable Networks on Chip: DRNoC architecture

  • Krasteva, Yana E.
  • de la Torre, Eduardo
  • Riesgo, Teresa;

Journal Of Systems Architecture (p. 293-302) - 1/7/2010

10.1016/j.sysarc.2010.04.003 View at source

  • ISSN 13837621

On the scalability of evolvable hardware architectures: comparison of systolic array and Cartesian genetic programming

  • Mora, Javier
  • Salvador, Ruben
  • de la Torre, Eduardo;

Genetic Programming And Evolvable Machines (p. 155-186) - 1/6/2019

10.1007/s10710-018-9340-5 View at source

  • ISSN 13892576

Multi-grain reconfigurable and scalable overlays for hardware accelerator composition

  • Zamacola R
  • Otero A
  • de la Torre E

Journal Of Systems Architecture - 1/1/2021

10.1016/j.sysarc.2021.102302 View at source

  • ISSN 13837621

Lossy hyperspectral image compression on a reconfigurable and fault-tolerant fpga-based adaptive computing platform†

  • Barrios Y
  • Rodríguez A
  • Sánchez A
  • Pérez A
  • López S
  • Otero A
  • de la Torre E
  • Sarmiento R
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Electronics (p. 1-23) - 1/10/2020

10.3390/electronics9101576 View at source

  • ISSN 08834989

FPGAs: Fundamentals, advanced features, and applications in industrial electronics

  • Andina JJR
  • de la Torre Arnanz E
  • Peña MDV

(p. 1-250) - 1/1/2017

10.1201/9781315162133 View at source

Wireless Sensor Networks: From Real World to System Integration - Alternative Hardware Approaches

  • Portilla J
  • Otero A
  • Rosello V
  • Valverde J
  • Krasteva Y
  • de la Torre E
  • Riesgo T
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Comprehensive Materials Processing (p. 353-373) - 1/1/2014

10.1016/b978-0-08-096532-1.01313-3 View at source

Run-time scalable architecture for deblocking filtering in H.264/AVC and SVC video codecs

  • Teresa Cervero
  • S. López
  • G. Gallicó
  • OTERO MARNOTES, JOSE ANDRES
  • RIESGO ALCAIDE, TERESA
  • TORRE ARNANZ, EDUARDO DE LA

Embedded Systems Design With Fpgas (p. 173-199) - 1/11/2013

10.1007/978-1-4614-1362-2_8 View at source

FPGAs and reconfigurable systems

  • Rodriguez-Andina JJ
  • de la Torre E

Fundamentals Of Industrial Electronics (p. 24-1-24-18) - 19/4/2016

  • iMarina

Dynamic reconfigurable NoC (DRNoC) architecture: Application to fast NoC emulation

  • Krasteva Y
  • de la Torre E
  • Riesgo T

Dynamic Reconfigurable Network-On-Chip Design: Innovations For Computational Processing And Communication (p. 220-254) - 1/12/2010

10.4018/978-1-61520-807-4.ch009 View at source

Adaptivity and Self-awareness of CPSs and CPSoSs

  • De La Torre E

Heterogeneous Cyber Physical Systems Of Systems (p. 37-60) - 1/1/2021

  • iMarina

Virtual Architectures for Partial Runtime Reconfigurable Systems. Application to Network on Chip based SoC Emulation

  • Krasteva Y
  • De La Torre E
  • Riesgo T

Ieee Annual Conference Of The Ieee Industrial Electronics Society (Iecon'08) (p. 0-0) - 10/11/2008

10.1109/iecon.2008.4758347 View at source

Virtex II FPGA bitstream manipulation: Application to reconfiguration control systems

  • Krasteva Y
  • De La Torre E
  • Riesgo T
  • Joly D

Proceedings - 2006 International Conference On Field Programmable Logic And Applications, Fpl (p. 717-720) - 1/12/2006

10.1109/fpl.2006.311298 View at source

Using Partial Reconfiguration for SoC Design and Implementation

  • F. Tobajas
  • TORRE ARNANZ, EDUARDO DE LA
  • PORTILLA BERRUECO, JORGE

Proceedings Of Spie - The International Society For Optical Engineering (p. 736.306-1.736.304) - 14/9/2009

10.1117/12.821718 View at source

  • ISSN 0277786X

Use of standards in electronic design

  • Riesgo T
  • de la Torre E
  • Torroja Y
  • Uceda J

Iecon-2002: Proceedings Of The 2002 28th Annual Conference Of The Ieee Industrial Electronics Society, Vols 1-4 (p. 407-412) - 1/12/1996

  • iMarina

Towards fine and medium grain dynamic functional extraction for HW/SW acceleration

  • Matev, V.
  • de la Torre, E.
  • Riesgo, T.;

2007 3rd Southern Conference On Programmable Logic, Proceedings (p. 93-+) - 27/9/2007

10.1109/spl.2007.371730 View at source

Towards fine and medium grain dynamic functional extraction

  • RIESGO ALCAIDE, TERESA
  • TORRE ARNANZ, EDUARDO DE LA
  • STEFANOV MATEV, VLADIMIR

1/2/2007

  • iMarina

Teaching hybrid HW/SW embedded system design using FPGA-based devices

  • RIESGO ALCAIDE, TERESA
  • TORRE ARNANZ, EDUARDO DE LA
  • Rodriguez Medina, Alfonso
  • PORTILLA BERRUECO, JORGE

2016 Conference On Design Of Circuits And Integrated Systems, Dcis 2016 - Proceedings (p. 161-166) - 6/2/2017

10.1109/dcis.2016.7845372 View at source

Teaching embedded systems and microcontrollers using scale models

  • Torroja, Y
  • Garcia, O
  • Riesgo, T
  • de la Torre, E

Iecon-2002: Proceedings Of The 2002 28th Annual Conference Of The Ieee Industrial Electronics Society, Vols 1-4 (p. 2180-2183) - 1/12/2005

10.1109/iecon.2005.1569242 View at source

TESTING VLSI CIRCUITS FROM VHDL DESCRIPTIONS

  • RIESGO, T
  • TORROJA, Y
  • DELATORRE, E
  • UCEDA, J;

Proceedings Of The 1992 International Conference On Industrial Electronics, Control, Instrumentation, And Automation, Vols 1-3 (p. 1052-1057) - 1/1/1992

10.1109/iecon.1992.254467 View at source

Straight method for reallocation of complex cores by dynamic reconfiguration in Virtex II FPGAs

  • Krasteva Y
  • Jimeno A
  • De La Torre E
  • Riesgo T

Proceedings Of The International Workshop On Rapid System Prototyping (p. 77-83) - 18/10/2005

10.1109/rsp.2005.45 View at source

  • ISSN 10746005

This researcher has no working papers.

This researcher has no technical reports.

WSN Development, Planning and Commissioning & Maintenance ToolSet

  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))

Period: 01-01-2011 - 31-12-2014

Type of funding: National

Amount of funding: 242569,60 Euros.

  • iMarina

Tecnologías de IoT cognitiva para una transición digital segura centrada en las personas

  • HERNANDEZ LORITE, ROGELIO (Miembro del equipo de trabajo)
  • SUN, JUNJIAO (Miembro del equipo de trabajo)
  • PEREZ TORRERO, FERNANDO (Miembro del equipo de trabajo)
  • MUJICA ROJAS, GABRIEL NOE (Participante)
  • Rodriguez Medina, Alfonso (Participante)
  • OTERO MARNOTES, JOSE ANDRES (Participante)
  • MARIÑO ANDRES, RODRIGO (Participante)
  • ENCINAS ANCHUSTEGUI, JUAN (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • PORTILLA BERRUECO, JORGE (Investigador principal (IP))
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Period: 01-12-2022 - 30-11-2024

Type of funding: National

Amount of funding: 245065,00 Euros.

  • iMarina

TECNOCAI. Tecnologías eficientes e inteligentes orientadas a la salud y al confort en ambientes interiores.

  • Rodriguez Medina, Alfonso (Participante)
  • ZAMACOLA ALCALDE, RAFAEL MARIA (Participante)
  • ZATO RECELLADO, José Gabriel (Investigador principal (IP))
  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
  • CECILIA FERNÁNDEZ-CONDE, LOURDES (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • NARANJO HERNANDEZ, JOSE EUGENIO (Participante)
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Period: 01-12-2009 - 01-12-2012

Type of funding: National

Amount of funding: 26100,00 Euros.

  • iMarina

TALENT-HIPSTER: HIgh Performance Systems and Technologies for E-health and fish faRming

  • CEBRIAN CASTEL, PEDRO LUIS (Miembro del equipo de trabajo)
  • Señor Sánchez, Jaime (Miembro del equipo de trabajo)
  • VILLA ROMERO, MANUEL (Miembro del equipo de trabajo)
  • Sutradhar, Pallab (Miembro del equipo de trabajo)
  • MARTIN PEREZ, ALBERTO (Miembro del equipo de trabajo)
  • MONTERO CORDAL, LUCAS (Miembro del equipo de trabajo)
  • URBANOS GARCIA, GEMMA (Miembro del equipo de trabajo)
  • VAZQUEZ IGLESIAS, DANIEL (Miembro del equipo de trabajo)
  • PORTILLA BERRUECO, JORGE (Investigador principal (IP))
  • JUAREZ MARTINEZ, EDUARDO (Investigador principal (IP))
  • PESCADOR DEL OSO, FERNANDO (Participante)
  • LOBO PEREA, PEDRO JOSE (Participante)
  • MUJICA ROJAS, GABRIEL NOE (Participante)
  • Rodriguez Medina, Alfonso (Participante)
  • GARRIDO GONZALEZ, MATIAS JAVIER (Participante)
  • CHAVARRIAS LAPASTORA, MIGUEL (Participante)
  • SANZ ALVARO, CESAR (Participante)
  • GROBA GONZALEZ, ANGEL MANUEL (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • MENESES CHAUS, JUAN MANUEL (Miembro del equipo de trabajo)
  • SANCHO ARAGON, JAIME (Miembro del equipo de trabajo)
  • OTERO MARNOTES, JOSE ANDRES (Miembro del equipo de trabajo)
  • MARIÑO ANDRES, RODRIGO (Miembro del equipo de trabajo)
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Period: 01-09-2021 - 31-08-2024

Type of funding: National

Amount of funding: 304678,00 Euros.

  • iMarina

Sistemas electrónicos empotrados confiables para control de ciudades bajo situaciones atípicas

  • NIETO CHAMORRO, FRANCISCO JOSE (Miembro del equipo de trabajo)
  • MORENA BERODAS, ALVARO (Miembro del equipo de trabajo)
  • ORTIZ CUADRADO, ALBERTO (Miembro del equipo de trabajo)
  • LANZA GUTIERREZ, JOSE MANUEL (Miembro del equipo de trabajo)
  • MARIÑO ANDRES, RODRIGO (Miembro del equipo de trabajo)
  • WILSULTSCHEW PUIGDELLIVOL, CRISTIAN (Miembro del equipo de trabajo)
  • GARCIA GENER, ALEJANDRO (Miembro del equipo de trabajo)
  • TORRE ARNANZ, EDUARDO DE LA (Investigador principal (IP))
  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
  • PORTILLA BERRUECO, JORGE (Participante)
  • TORROJA FUNGAIRIÑO, YAGO (Participante)
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Period: 01-01-2015 - 30-06-2018

Type of funding: National

Amount of funding: 129470,00 Euros.

  • iMarina

Sistema de iluminación inteligente.

  • VILLAVERDE SAN JOSE, MONICA (Miembro del equipo de trabajo)
  • NOGAR CANTERO, NOEMÍ (Miembro del equipo de trabajo)
  • RIESGO ALCAIDE, TERESA (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Investigador principal (IP))

Period: 04-05-2011 - 05-01-2013

Type of funding: National

Amount of funding: 196859,00 Euros.

  • iMarina

SecBluRed

  • ALVAREZ-CAMPANA FDEZ.-CORREDOR, MANUEL (Investigador principal (IP))
  • MARIN LOPEZ, ANDRES ISAAC (Participante)
  • Villagrá González, Victor Abraham (Participante)
  • Berrocal Colmenarejo, Julio José (Participante)
  • OTERO MARNOTES, JOSE ANDRES (Participante)
  • PORTILLA BERRUECO, JORGE (Investigador principal (IP))
  • Rodriguez Medina, Alfonso (Participante)
  • MUJICA ROJAS, GABRIEL NOE (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
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Period: 22-12-2022 - 31-12-2025

Type of funding: National

  • iMarina

SERVICIO DE APOYO TECNICO PARA DISEÑO E IMPLEMENTACION DE ALGORITMO INTELIGENTE DE DETECCION DE EMOCIONES A PARTIR DE SENSORES FISIOLOGICOS, EN TIEMPO REAL Y EFICIENTE EN CONSUMO Y AREA

  • TORRE ARNANZ, EDUARDO DE LA (Colaborador/a)
  • Rodriguez Medina, Alfonso (Colaborador/a)
  • MUJICA ROJAS, GABRIEL NOE (Colaborador/a)
  • OTERO MARNOTES, JOSE ANDRES (Colaborador/a)
  • PORTILLA BERRUECO, JORGE (Investigador principal (IP))

Period: 01-09-2019 - 28-02-2022

Type of funding: Internal

  • iMarina

Reconfigurable ultra-autonomous novel robots: RUNNER

  • Rodriguez Medina, Alfonso (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • RIESGO ALCAIDE, TERESA (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Investigador principal (IP))

Period: 01-12-2010 - 31-12-2013

Type of funding: National

Amount of funding: 55500,00 Euros.

  • iMarina

Reconfigurable Ultra-Autonomous Novel Robots

  • TORRE ARNANZ, EDUARDO DE LA (Investigador principal (IP))

Period: 01-12-2010 - 31-12-2013

Type of funding: International

  • iMarina

Side-Channel Attack Protection Techniques in FPGA Systems using Enhanced Dual-Rail Solutions

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: He, Wei

1/1/2014

  • iMarina

Runtime Adaptive Hardware/Software Execution in Complex Heterogeneous Systems

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Suriano, Leonardo

31/1/2021

  • iMarina

Run-Time Scalable Hardware for Reconfigurable Systems

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Otero Marnotes, Andres

1/1/2014

  • iMarina

Run-Time Dynamically-Adaptable FPGA-Based Architecture for High-Performance Autonomous Distributed Systems

  • PORTILLA BERRUECO, JORGE (Director)
  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Valverde Alcalá, Juan

1/1/2015

  • iMarina

Reconfigurable Computing Based on Commercial FPGAs. Solutions for the Design and Implementation of Partially Reconfigurable Systems = Computación reconfigurable basada en FPGAs comerciales. Soluciones para el diseño e implementación de sistemas parcialmente reconfigurables.

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Esteves Krasteva, Yana

1/1/2009

  • iMarina

Real-time and dependability assessment of hw-accelerated space applications for reconfigurable MPSoCs

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Pérez García, Arturo

12/5/2023

  • iMarina

Parametric and structural self-adaptation of embedded systems using evolvable hardware

  • SEKANINA, Lukáš (Director)
  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Salvador Perea, Rubén

1/1/2015

  • iMarina

Emulación en prototipos basados en fpgas: métodos de depuración mediante inserción de lógica compatible con el estándar ieee-1149.1

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: GARCIA VALDERAS, Mario

1/1/2004

  • iMarina

Design Methodologies and Architectures for Just-in-Time Hardware Composition of Multi Grain Reconfigurable Accelerators

  • Otero Marnotes, Andrés (Director)
  • TORRE ARNANZ, EDUARDO DE LA (Director)
  • OTERO MARNOTES, JOSE ANDRES (Codirector) Doctorando: Zamacola Alcalde, Rafael María

4/7/2022

  • iMarina

Architecture and methodology for automated development of evolvable and reconfigurable hardware applications

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Mora de Sambricio, Javier

1/1/2019

  • iMarina

This researcher has no patents or software licenses.

Last data update: 4/24/24 1:14 PM