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Perfil en el portal institucional

Torre Arnanz, Eduardo De La eduardo.delatorre@upm.es

AUTOMÁTICA, INGENIERÍA ELÉCTRICA Y ELECTRÓNICA E INFORMÁTICA INDUSTRIAL / Universidad Politécnica de Madrid

Actividades

A NEW APPROACH ON FAULT LIST HANDLING FOR FASTER FAULT ELIMINATION AND DIRECT TEST VECTOR GENERATION

  • AGUADO, MJ
  • CONESA, JL
  • DELATORRE, E
  • UCEDA, J;

Microprocessing And Microprogramming (p. 853-860) - 1/1/1991

10.1016/0165-6074(91)90449-4 Ver en origen

  • ISSN 01656074

Design methodologies based on hardware description languages

  • Riesgo, T
  • Torroja, Y
  • de la Torre, E;

Ieee Transactions On Industrial Electronics (p. 3-12) - 1/12/1999

10.1109/41.744370 Ver en origen

  • ISSN 02780046

Hardware and software debugging of FPGA based microprocessor systems through debug logic insertion

  • Valderas M
  • de la Torre E
  • Ariza F
  • Riesgo T

Lecture Notes In Computer Science (p. 1057-1061) - 1/1/2004

  • ISSN 03029743
  • iMarina

ENAMORADO: Enabling Nomadic Agents in a Multimedia ORiented Architecture of Distributed Objects

  • Krasteva, Yana E.
  • Papagianni, Chrysa
  • Kosmatos, Evangelos
  • De La Torre, Eduardo
  • Venieris, Iakovos S.
  • Riesgo, Teresa;

Innovation And The Knowledge Economy: Issues, Applications, Case Studies, Pts 1 & 2 (p. 975-982) - 1/1/2005

  • ISSN 15741230
  • iMarina

A modular architecture for nodes in wireless sensor networks

  • Portilla, J
  • de Castro, A
  • de la Torre, E
  • Riesgo, T

Journal Of Universal Computer Science (p. 328-339) - 28/4/2006

10.3217/jucs-012-03-0328 Ver en origen

  • ISSN 0948695X

Adaptable Security in Wireless Sensor Networks by Using Reconfigurable ECC Hardware Coprocessors

  • Portilla, J.
  • Otero, A.
  • de la Torre, E.
  • Riesgo, T.
  • Stecklina, O.
  • Peter, S.
  • Langendoerfer, P.;
... Ver más Contraer

International Journal Of Distributed Sensor Networks - 1/12/2010

10.1155/2010/740823 Ver en origen

  • ISSN 15501329

Reconfigurable Networks on Chip: DRNoC architecture

  • Krasteva, Yana E.
  • de la Torre, Eduardo
  • Riesgo, Teresa;

Journal Of Systems Architecture (p. 293-302) - 1/7/2010

10.1016/j.sysarc.2010.04.003 Ver en origen

  • ISSN 13837621

Embedded Runtime Reconfigurable Nodes for Wireless Sensor Networks Applications

  • Esteves Krasteva, Yana
  • Portilla, Jorge
  • de la Torre, Eduardo
  • Riesgo, Teresa;

Ieee Sensors Journal (p. 1800-1810) - 5/8/2011

10.1109/jsen.2011.2104948 Ver en origen

  • ISSN 1530437X

Using SRAM based FPGAs for power-aware high performance wireless sensor networks

  • Valverde, Juan
  • Otero, Andres
  • Lopez, Miguel
  • Portilla, Jorge
  • de la Torre, Eduardo
  • Riesgo, Teresa

Sensors (p. 2667-2692) - 1/3/2012

10.3390/s120302667 Ver en origen

  • ISSN 14248220

Self-Reconfigurable Evolvable Hardware System for Adaptive Image Processing

  • Salvador, Ruben
  • Otero, Andres
  • Mora, Javier
  • de la Torre, Eduardo
  • Riesgo, Teresa
  • Sekanina, Lukas;

Ieee Transactions On Computers (p. 1481-1493) - 22/7/2013

10.1109/tc.2013.78 Ver en origen

  • ISSN 00189340

FPGAs: Fundamentals, advanced features, and applications in industrial electronics

  • Andina JJR
  • de la Torre Arnanz E
  • Peña MDV

(p. 1-250) - 1/1/2017

10.1201/9781315162133 Ver en origen

Dynamic reconfigurable NoC (DRNoC) architecture: Application to fast NoC emulation

  • Krasteva Y
  • de la Torre E
  • Riesgo T

Dynamic Reconfigurable Network-On-Chip Design: Innovations For Computational Processing And Communication (p. 220-254) - 1/12/2010

10.4018/978-1-61520-807-4.ch009 Ver en origen

Run-time scalable architecture for deblocking filtering in H.264/AVC and SVC video codecs

  • Teresa Cervero
  • S. López
  • G. Gallicó
  • OTERO MARNOTES, JOSE ANDRES
  • RIESGO ALCAIDE, TERESA
  • TORRE ARNANZ, EDUARDO DE LA

Embedded Systems Design With Fpgas (p. 173-199) - 1/11/2013

10.1007/978-1-4614-1362-2_8 Ver en origen

Wireless Sensor Networks: From Real World to System Integration - Alternative Hardware Approaches

  • Portilla J
  • Otero A
  • Rosello V
  • Valverde J
  • Krasteva Y
  • de la Torre E
  • Riesgo T
... Ver más Contraer

Comprehensive Materials Processing (p. 353-373) - 1/1/2014

10.1016/b978-0-08-096532-1.01313-3 Ver en origen

FPGAs and reconfigurable systems

  • Rodriguez-Andina JJ
  • de la Torre E

Fundamentals Of Industrial Electronics (p. 24-1-24-18) - 19/4/2016

  • iMarina

Adaptivity and Self-awareness of CPSs and CPSoSs

  • De La Torre E

Heterogeneous Cyber Physical Systems Of Systems (p. 37-60) - 1/1/2021

  • iMarina

A comparative analysis of different fault simulation techniques for VLSI circuits testing

  • Torroja Y
  • Riesgo T
  • de la Torre E
  • Uceda J

Iecon 91, Vols 1-3 (p. 1226-1231) - 1/12/1991

  • iMarina

TESTING VLSI CIRCUITS FROM VHDL DESCRIPTIONS

  • RIESGO, T
  • TORROJA, Y
  • DELATORRE, E
  • UCEDA, J;

Proceedings Of The 1992 International Conference On Industrial Electronics, Control, Instrumentation, And Automation, Vols 1-3 (p. 1052-1057) - 1/1/1992

10.1109/iecon.1992.254467 Ver en origen

Distributed implementation of an ATPG system using dynamic fault allocation

  • AGUADO, MJ
  • DELATORRE, E
  • MIRANDA, MA
  • LOPEZBARRIO, C;

Proceedings Of The International Test Conference (p. 409-418) - 1/12/1993

10.1109/test.1993.470671 Ver en origen

Dynamic communication strategy for the distributed ATPG system DPLATON

  • AGUADO, MJ
  • MIRANDA, MA
  • DELATORRE, E
  • LOPEZBARRIO, C;

European Design Automation Conference - Proceedings (p. 271-276) - 1/12/1993

  • iMarina

CAD in test

  • Riesgo T
  • de la Torre E
  • Torroja Y
  • Olias E
  • Uceda J

(p. 33-38) - 1/12/1995

  • iMarina

Model generation of test logic for macrocell based designs

  • de la Torre E
  • Calvo J
  • Uceda J

Euro-Dac '96 - European Design Automation Conference With Euro-Vhdl '96 And Exhibition, Proceedings (p. 456-461) - 1/1/1996

10.1109/eurdac.1996.558243 Ver en origen

Use of standards in electronic design

  • Riesgo T
  • de la Torre E
  • Torroja Y
  • Uceda J

Iecon-2002: Proceedings Of The 2002 28th Annual Conference Of The Ieee Industrial Electronics Society, Vols 1-4 (p. 407-412) - 1/12/1996

  • iMarina

Quality estimation of test vectors and functional validation procedures based on fault and error models

  • Riesgo, T
  • Torroja, Y
  • de la Torre, E
  • Uceda, J;

Design, Automation And Test In Europe, Proceedings (p. 955-956) - 1/12/1998

10.1109/date.1998.655986 Ver en origen

A set of hardware components for a reconfigurable control and communications board

  • Casado F
  • Machado F
  • Riesgo T
  • De La Torre E
  • Torroja Y
  • Uceda J

(p. 1707-1712) - 1/1/2000

10.1109/iecon.2000.972533 Ver en origen

Highly configurable control boards: A tool and a design experience

  • de la Torre, E
  • Riesgo, T
  • Uceda, J
  • Macip, E
  • Rizzi, M;

Proceedings Of The International Workshop On Rapid System Prototyping (p. 174-179) - 1/1/2000

10.1109/iwrsp.2000.855218 Ver en origen

  • ISSN 10746005

Este/a investigador/a no tiene documentos de trabajo.

Este/a investigador/a no tiene informes técnicos.

Reconfigurabilidad Dinámica para Escalabilidad en Redes Orientadas a Aplicaciones Multimedia

  • PORTILLA BERRUECO, JORGE (Participante)
  • SALVADOR PEREA, RUBEN (Participante)
  • OTERO MARNOTES, JOSE ANDRES (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • TORROJA FUNGAIRIÑO, YAGO (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
... Ver más Contraer

Ejecución: 01-01-2009 - 31-12-2011

Tipo: Nacional

  • iMarina

TECNOCAI. Tecnologías eficientes e inteligentes orientadas a la salud y al confort en ambientes interiores.

  • Rodriguez Medina, Alfonso (Participante)
  • ZAMACOLA ALCALDE, RAFAEL MARIA (Participante)
  • ZATO RECELLADO, José Gabriel (Investigador principal (IP))
  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
  • CECILIA FERNÁNDEZ-CONDE, LOURDES (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • NARANJO HERNANDEZ, JOSE EUGENIO (Participante)
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Ejecución: 01-12-2009 - 01-12-2012

Tipo: Nacional

Importe financiado: 26100,00 Euros.

  • iMarina

Reconfigurable ultra-autonomous novel robots: RUNNER

  • Rodriguez Medina, Alfonso (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • RIESGO ALCAIDE, TERESA (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Investigador principal (IP))

Ejecución: 01-12-2010 - 31-12-2013

Tipo: Nacional

Importe financiado: 55500,00 Euros.

  • iMarina

Reconfigurable Ultra-Autonomous Novel Robots

  • TORRE ARNANZ, EDUARDO DE LA (Investigador principal (IP))

Ejecución: 01-12-2010 - 31-12-2013

Tipo: Internacional

  • iMarina

WSN Development, Planning and Commissioning & Maintenance ToolSet

  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))

Ejecución: 01-01-2011 - 31-12-2014

Tipo: Nacional

Importe financiado: 242569,60 Euros.

  • iMarina

ENCE-NG: Enclavamiento Electrónico de Nueva Generación

  • ZAMACOLA ALCALDE, RAFAEL MARIA (Participante)
  • VILLAVERDE SAN JOSE, MONICA (Participante)
  • ALEDO ORTEGA, DAVID (Participante)
  • Rodriguez Medina, Alfonso (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Investigador principal (IP))
  • RIESGO ALCAIDE, TERESA (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • GARCIA SUAREZ, OSCAR (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
... Ver más Contraer

Ejecución: 17-10-2011 - 16-04-2013

Tipo: Nacional

  • iMarina

Open Source FPGA Accelerator & Hardware-Software Codesign Toolset for CUDA Kernels

  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • TORROJA FUNGAIRIÑO, YAGO (Participante)
  • OTERO MARNOTES, JOSE ANDRES (Participante)
  • SALVADOR PEREA, RUBEN (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
... Ver más Contraer

Ejecución: 01-11-2011 - 31-10-2013

Tipo: Internacional

Importe financiado: 302068,00 Euros.

  • iMarina

Sistema de iluminación inteligente.

  • VILLAVERDE SAN JOSE, MONICA (Miembro del equipo de trabajo)
  • NOGAR CANTERO, NOEMÍ (Miembro del equipo de trabajo)
  • RIESGO ALCAIDE, TERESA (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Investigador principal (IP))

Ejecución: 04-05-2011 - 05-01-2013

Tipo: Nacional

Importe financiado: 196859,00 Euros.

  • iMarina

ICT Tools greening food processing businesses

  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
  • PORTILLA BERRUECO, JORGE (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • TORROJA FUNGAIRIÑO, YAGO (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • MAIGLER LÓPEZ, Mª VICTORIA (Participante)
  • ALEDO ORTEGA, DAVID (Participante)
  • ALONSO FERNÁNDEZ, JESÚS (Participante)
  • ARCAS CASTRO, GUILLERMO DE (Participante)
  • MUJICA ROJAS, GABRIEL NOE (Participante)
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Ejecución: 12-09-2011 - 11-09-2014

Tipo: Internacional

Importe financiado: 109170,00 Euros.

  • iMarina

Dynamically Reconfigurable embedded platforms for Networked Context-aware multimedia Systems-UPM

  • RIESGO ALCAIDE, TERESA (Investigador principal (IP))
  • TORROJA FUNGAIRIÑO, YAGO (Participante)
  • OTERO MARNOTES, JOSE ANDRES (Participante)
  • PORTILLA BERRUECO, JORGE (Participante)
  • MORENO GONZALEZ, FELIX ANTONIO (Participante)
  • TORRE ARNANZ, EDUARDO DE LA (Participante)
  • ABAD ARROYO, RICARDO (Participante)
  • MUJICA ROJAS, GABRIEL NOE (Participante)
... Ver más Contraer

Ejecución: 01-01-2012 - 30-06-2015

Tipo: Nacional

Importe financiado: 88088,00 Euros.

  • iMarina

Emulación en prototipos basados en fpgas: métodos de depuración mediante inserción de lógica compatible con el estándar ieee-1149.1

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: GARCIA VALDERAS, Mario

1/1/2004

  • iMarina

Reconfigurable Computing Based on Commercial FPGAs. Solutions for the Design and Implementation of Partially Reconfigurable Systems = Computación reconfigurable basada en FPGAs comerciales. Soluciones para el diseño e implementación de sistemas parcialmente reconfigurables.

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Esteves Krasteva, Yana

1/1/2009

  • iMarina

Run-Time Scalable Hardware for Reconfigurable Systems

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Otero Marnotes, Andres

1/1/2014

  • iMarina

Side-Channel Attack Protection Techniques in FPGA Systems using Enhanced Dual-Rail Solutions

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: He, Wei

1/1/2014

  • iMarina

Run-Time Dynamically-Adaptable FPGA-Based Architecture for High-Performance Autonomous Distributed Systems

  • PORTILLA BERRUECO, JORGE (Director)
  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Valverde Alcalá, Juan

1/1/2015

  • iMarina

Parametric and structural self-adaptation of embedded systems using evolvable hardware

  • SEKANINA, Lukáš (Director)
  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Salvador Perea, Rubén

1/1/2015

  • iMarina

Architecture and methodology for automated development of evolvable and reconfigurable hardware applications

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Mora de Sambricio, Javier

1/1/2019

  • iMarina

A Framework to Support Run-Time Adaptation in Reconfigurable Multi-Accelerator Systems

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Rodríguez Medina, Alfonso

10/10/2020

  • iMarina

Runtime Adaptive Hardware/Software Execution in Complex Heterogeneous Systems

  • TORRE ARNANZ, EDUARDO DE LA (Director) Doctorando: Suriano, Leonardo

31/1/2021

  • iMarina

Design Methodologies and Architectures for Just-in-Time Hardware Composition of Multi Grain Reconfigurable Accelerators

  • Otero Marnotes, Andrés (Director)
  • TORRE ARNANZ, EDUARDO DE LA (Director)
  • OTERO MARNOTES, JOSE ANDRES (Codirector) Doctorando: Zamacola Alcalde, Rafael María

4/7/2022

  • iMarina

Este/a investigador/a no tiene patentes o licencias de software.

Última actualización de los datos: 24/04/24 13:14